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VHDL语言100例详解(含代码)

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最后更新: 2019-12-25 19:37:08

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所属分类其他
开发工具:Visual C++
文件大小:6707KB
下载次数:3
上传日期:2017-08-02 18:39:34
说明:  基于CAN通信的介绍,ISO11898标准的介绍,对于学习CAN通信很有帮助
(Based on the introduction of CAN communication, ISO11898 standard introduction, for learning CAN communication helpful)

文件列表
VHDL语言100例\VHDL语言100例\100Examples\10_function\10_bit_to_int.vhd
VHDL语言100例\VHDL语言100例\100Examples\10_function\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\11_wiredor\11_wiredor.vhd
VHDL语言100例\VHDL语言100例\100Examples\11_wiredor\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\12_convert\12_convert.vhd
VHDL语言100例\VHDL语言100例\100Examples\12_convert\README.TXT
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VHDL语言100例\VHDL语言100例\100Examples\13_SHL\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\14_MVL7_functions\14_MVL7_functions.vhd
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VHDL语言100例\VHDL语言100例\100Examples\15_MUX41\15_MUX41.VHD
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VHDL语言100例\VHDL语言100例\100Examples\32_test_110b\32_test_110b.vhd
VHDL语言100例\VHDL语言100例\100Examples\33_comparer\33_COMP.VHD
VHDL语言100例\VHDL语言100例\100Examples\33_comparer\33_comparer.vhd
VHDL语言100例\VHDL语言100例\100Examples\33_comparer\33_SIMU.VHD
VHDL语言100例\VHDL语言100例\100Examples\33_comparer\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\34_BUS\34_readwrite.VHD
VHDL语言100例\VHDL语言100例\100Examples\34_BUS\34_readwrite_stim.vhd
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VHDL语言100例\VHDL语言100例\100Examples\35_486_bus\35_486_bus.vhd
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VHDL语言100例\VHDL语言100例\100Examples\35_486_bus\75_RAM.VHD
VHDL语言100例\VHDL语言100例\100Examples\35_486_bus\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\36_GCD\36_GCD.VHD
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VHDL语言100例\VHDL语言100例\100Examples\39_wst0dp\39_wst0dp.vhd
VHDL语言100例\VHDL语言100例\100Examples\39_wst0dp\README.TXT
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VHDL语言100例\VHDL语言100例\100Examples\40_generic_dec\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\41_generic_testbench\40_generic_dec.vhd
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VHDL语言100例\VHDL语言100例\100Examples\41_generic_testbench\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\42_MIX\42_MIX.VHD
VHDL语言100例\VHDL语言100例\100Examples\42_MIX\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\43_register\43_shift_reg.vhd
VHDL语言100例\VHDL语言100例\100Examples\43_register\43_test_register.vhd
VHDL语言100例\VHDL语言100例\100Examples\43_register\README.TXT
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VHDL语言100例\VHDL语言100例\100Examples\44_reg_counter\44_reg_counter.vhd
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VHDL语言100例\VHDL语言100例\100Examples\45_test_63\45_test_63.vhd
VHDL语言100例\VHDL语言100例\100Examples\46_generic\46_default_generic.vhd
VHDL语言100例\VHDL语言100例\100Examples\46_generic\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\47_CONST\47_const_test.vhd
VHDL语言100例\VHDL语言100例\100Examples\48_test_18e\48_test_18e.vhd
VHDL语言100例\VHDL语言100例\100Examples\49_DELTA\49_TEST.VHD
VHDL语言100例\VHDL语言100例\100Examples\4_COMP\4_COMP.VHD
VHDL语言100例\VHDL语言100例\100Examples\4_COMP\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\50_test_18e\50_test_18e.vhd
VHDL语言100例\VHDL语言100例\100Examples\51_test_113\51_test_113.vhd
VHDL语言100例\VHDL语言100例\100Examples\52_divider\52_DIVIDER.vhd
VHDL语言100例\VHDL语言100例\100Examples\52_divider\52_Divider_stim.vhd
VHDL语言100例\VHDL语言100例\100Examples\52_divider\README.TXT
VHDL语言100例\VHDL语言100例\100Examples\53_counter\53_counter.vhd

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